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다음 중 SR 플립플롭의 부정 상태가 출력으로 나타나지 않도록 개량하여 부정 상태 없이 불변, 0, 1 토글의 4가지 출력을 가지는 플립플롭은?
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8일전
D 플립플롭 T 플립플롭 H 플립플롭 JK 플립플롭
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비동기식 입출력 장치의 특징이 아닌 것은?
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8일전
오픈 루트 방식을 사용할 수 있다. 핸드셰이킹 방식을 사용할 수 없다. 송수신 장치가 자신의 타이밍에 독립적…
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고정배선제어에 비해 마이크로프로그램을 이용한 제어 방식이 가지는 장점으로 틀린 것은?
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8일전
동작 속도를 극대화할 수 있다. 제어 논리의 설계를 프로그램 작업으로 수행할 수 있다. 개발기간을 단축시킬 …
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DRAM(Dynamic Random Access Memory)에 대한 설명으로 옳은 것은?
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8일전
Content Addressable 메모리이다. 주기적으로 메모리를 refresh하여야 한다. Dynamic…
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데이지 체인(Daisy chain) 기법을 가장 올바르게 설명한 것은?
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8일전
3개 이상의 장치들이 핸드셰이킹(hand shaking) 기법을 사용하는 것 주소가 서로 상충(collisi…
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연산의 결과 올림수가 발생하면 1이 되는 flag는 어느 것인가?
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8일전
zero flag sing flag parity flag carry flag
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다음 중 특정 비트만 0으로 하기 위한 연산은?
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8일전
OR 연산 AND 연산 EX-OR 연산 보수 연산
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DMA 제어장치가 꼭 갖추어야 할 필수 레지스터가 아닌 것은?
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8일전
status register program register data register address regis…
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컴퓨터 제어장치의 기본 사이클에 속하지 않는 것은?
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8일전
fetch cycle direct cycle execute cycle interrupt cycle
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다음 중에서 기억장치로부터 전송된 데이터를 일시적으로 저장하는 레지스터는?
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8일전
MAR MBR ALU 채널
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다음의 CPU 회로에서 점선 부분의 역할은 무엇인가?
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8일전
CPU를 리셋(Reset)시키기 위한 부분이다. CPU에 클록(Clock)을 공급하기 위한 부분이다. CPU…
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표준 비동기 직렬 데이터 전송에서 데이터 양식에 속하지 않는 것은?
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8일전
a atart bit(0) 5 to 8 data bit a status bit parity bit
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인출 사이클(frtch cycle) 수행 시 적합하지 않은 ㄱ마이크로 오퍼레이션은?
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8일전
DBUS←M[ABIS] IR←DBUS, RD←O ABUS←PC, RD←1 M[ABUS]←DBUS, WR←1
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주기억장치와 중앙처리장치와의 속도 차이를 해결하기 위하여 사용되는 기억장치는?
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8일전
캐시기억장치 가상기억장치 보조기억장치 연상기억장치
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CMOS형 IC의 장점으로 옳은 것은?
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8일전
소비 전력이 크다. 잡음 여유도가 크다. P형이나 N형보다 공정이 간단하다. 전원 전압 범위가 작다.
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