D 플립-플롭을 이용하여 그림과 같은 회로를 구성하고, 클럭(clk)단자에 5[kHz] 클럭펄스를 인가하였다. 동작시작단계에서…
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D 플립-플롭을 이용하여 그림과 같은 회로를 구성하고, 클럭(clk)단자에 5[kHz] 클럭펄스를 인가하였다. 동작시작단계에서 Q 출력을 +5[V]로 하였다면 출력은 ?
10[kHz]
2.5[kHz]
5[kHz]
5[V] DC
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