D 플립-플롭을 이용하여 그림과 같은회로를 구성하고, 클럭(clk) 단자에 5[㎑] 클럭 펄스를 인가하였다. 동작 시작단계에서…
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D 플립-플롭을 이용하여 그림과 같은회로를 구성하고, 클럭(clk) 단자에 5[㎑] 클럭 펄스를 인가하였다. 동작 시작단계에서 Q출력을 +5[㎑]로 하였다면 출력은?
10[㎑]
2.5[㎑]
5[㎑]
5[V] DC
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